xref: /aosp_15_r20/external/llvm/test/MC/SystemZ/insn-bad-zEC12.s (revision 9880d6810fe72a1726cb53787c6711e909410d58)

# For zEC12 only.
# RUN: not llvm-mc -triple s390x-linux-gnu -mcpu=zEC12 < %s 2> %t
# RUN: FileCheck < %t %s

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: lcbb	%r0, 0, 0

	lcbb	%r0, 0, 0

#CHECK: error: invalid operand
#CHECK: ntstg	%r0, -524289
#CHECK: error: invalid operand
#CHECK: ntstg	%r0, 524288

	ntstg	%r0, -524289
	ntstg	%r0, 524288

#CHECK: error: invalid operand
#CHECK: ppa	%r0, %r0, -1
#CHECK: error: invalid operand
#CHECK: ppa	%r0, %r0, 16

	ppa	%r0, %r0, -1
	ppa	%r0, %r0, 16

#CHECK: error: invalid operand
#CHECK: risbgn	%r0,%r0,0,0,-1
#CHECK: error: invalid operand
#CHECK: risbgn	%r0,%r0,0,0,64
#CHECK: error: invalid operand
#CHECK: risbgn	%r0,%r0,0,-1,0
#CHECK: error: invalid operand
#CHECK: risbgn	%r0,%r0,0,256,0
#CHECK: error: invalid operand
#CHECK: risbgn	%r0,%r0,-1,0,0
#CHECK: error: invalid operand
#CHECK: risbgn	%r0,%r0,256,0,0

	risbgn	%r0,%r0,0,0,-1
	risbgn	%r0,%r0,0,0,64
	risbgn	%r0,%r0,0,-1,0
	risbgn	%r0,%r0,0,256,0
	risbgn	%r0,%r0,-1,0,0
	risbgn	%r0,%r0,256,0,0

#CHECK: error: invalid operand
#CHECK: tabort	-1
#CHECK: error: invalid operand
#CHECK: tabort	4096
#CHECK: error: invalid use of indexed addressing
#CHECK: tabort	0(%r1,%r2)

	tabort	-1
	tabort	4096
	tabort	0(%r1,%r2)

#CHECK: error: invalid operand
#CHECK: tbegin	-1, 0
#CHECK: error: invalid operand
#CHECK: tbegin	4096, 0
#CHECK: error: invalid use of indexed addressing
#CHECK: tbegin	0(%r1,%r2), 0
#CHECK: error: invalid operand
#CHECK: tbegin	0, -1
#CHECK: error: invalid operand
#CHECK: tbegin	0, 65536

	tbegin	-1, 0
	tbegin	4096, 0
	tbegin	0(%r1,%r2), 0
	tbegin	0, -1
	tbegin	0, 65536

#CHECK: error: invalid operand
#CHECK: tbeginc	-1, 0
#CHECK: error: invalid operand
#CHECK: tbeginc	4096, 0
#CHECK: error: invalid use of indexed addressing
#CHECK: tbeginc	0(%r1,%r2), 0
#CHECK: error: invalid operand
#CHECK: tbeginc	0, -1
#CHECK: error: invalid operand
#CHECK: tbeginc	0, 65536

	tbeginc	-1, 0
	tbeginc	4096, 0
	tbeginc	0(%r1,%r2), 0
	tbeginc	0, -1
	tbeginc	0, 65536

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vab	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vaf	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vag	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vah	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vaq	%v0, %v0, %v0

	vab	%v0, %v0, %v0
	vaf	%v0, %v0, %v0
	vag	%v0, %v0, %v0
	vah	%v0, %v0, %v0
	vaq	%v0, %v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vaccb	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vaccf	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vaccg	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vacch	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vaccq	%v0, %v0, %v0

	vaccb	%v0, %v0, %v0
	vaccf	%v0, %v0, %v0
	vaccg	%v0, %v0, %v0
	vacch	%v0, %v0, %v0
	vaccq	%v0, %v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vacccq	%v0, %v0, %v0

	vacccq	%v0, %v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vacq	%v0, %v0, %v0

	vacq	%v0, %v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vavgb	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vavgf	%v0, %v0, %v0
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#CHECK: vavgg	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vavgh	%v0, %v0, %v0

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	vavgh	%v0, %v0, %v0

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#CHECK: vavglg	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vcdgb	%v0, %v0, 0, 0

	vcdgb	%v0, %v0, 0, 0

#CHECK: error: {{(instruction requires: vector)?}}
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	vcdlgb	%v0, %v0, 0, 0

#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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	vceqhs	%v0, %v0, %v0
	vceqfs	%v0, %v0, %v0
	vceqgs	%v0, %v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vcgdb	%v0, %v0, 0, 0

	vcgdb	%v0, %v0, 0, 0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchb	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchf	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchg	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchlb	%v0, %v0, %v0
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#CHECK: vchlf	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchlg	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchlh	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchlhs	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchlfs	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vchlgs	%v0, %v0, %v0

	vchlb	%v0, %v0, %v0
	vchlf	%v0, %v0, %v0
	vchlg	%v0, %v0, %v0
	vchlh	%v0, %v0, %v0
	vchlbs	%v0, %v0, %v0
	vchlhs	%v0, %v0, %v0
	vchlfs	%v0, %v0, %v0
	vchlgs	%v0, %v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vcksm	%v0, %v0, %v0

	vcksm	%v0, %v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vclgdb	%v0, %v0, 0, 0

	vclgdb	%v0, %v0, 0, 0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vclzb	%v0, %v0
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#CHECK: vclzf	%v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vclzg	%v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vclzh	%v0, %v0

	vclzb	%v0, %v0
	vclzf	%v0, %v0
	vclzg	%v0, %v0
	vclzh	%v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vctzb	%v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vctzf	%v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vctzg	%v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vctzh	%v0, %v0

	vctzb	%v0, %v0
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	vctzg	%v0, %v0
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#CHECK: vecb	%v0, %v0
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#CHECK: vecf	%v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vech	%v0, %v0

	vecb	%v0, %v0
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	vecg	%v0, %v0
	vech	%v0, %v0

#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: verimb	%v0, %v0, %v0, 0
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#CHECK: verimf	%v0, %v0, %v0, 0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: verimg	%v0, %v0, %v0, 0
#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: verimh	%v0, %v0, %v0, 0

	verimb	%v0, %v0, %v0, 0
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	verimh	%v0, %v0, %v0, 0

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	verllvh	%v0, %v0, %v0

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#CHECK: verllb	%v0, %v0, 0
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#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: veslvb	%v0, %v0, %v0
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#CHECK: veslh	%v0, %v0, 0

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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: error: {{(instruction requires: vector)?}}
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	vesravg	%v0, %v0, %v0
	vesravh	%v0, %v0, %v0

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#CHECK: vesrah	%v0, %v0, 0

	vesrab	%v0, %v0, 0
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	vesrah	%v0, %v0, 0

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	vfadb	%v0, %v0, %v0

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#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: vfaezhs	%v0, %v0, %v0
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	vfaefs	%v0, %v0, %v0
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#CHECK: error: {{(instruction requires: vector)?}}
#CHECK: vfeeb	%v0, %v0, %v0
#CHECK: error: {{(instruction requires: vector)?}}
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#CHECK: vfeneb   %v0, %v0, %v0
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#CHECK: vfenezb  %v0, %v0, %v0
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