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5 :Original: Documentation/arch/loongarch/irq-chip-model.rst
15 HTVECINTC（Hyper-Transport Vector Interrupt Controller）、PCH-PIC（LS7A芯片组的主中
16 断控制器）、PCH-LPC（LS7A芯片组的LPC中断控制器）和PCH-MSI（MSI中断控制器）。
19 全局中断控制器（每个芯片一个，所有核共享），而PCH-PIC/PCH-LPC/PCH-MSI是CPU外部的中
26 在这种模型里面，IPI（Inter-Processor Interrupt）和CPU本地时钟中断直接发送到CPUINTC，
27 CPU串口（UARTs）中断发送到LIOINTC，而其他所有设备的中断则分别发送到所连接的PCH-PIC/
28 PCH-LPC/PCH-MSI，然后被HTVECINTC统一收集，再发送到LIOINTC，最后到达CPUINTC::
30 +-----+ +---------+ +-------+
31 | IPI | --> | CPUINTC | <-- | Timer |
32 +-----+ +---------+ +-------+
35 +---------+ +-------+
36 | LIOINTC | <-- | UARTs |
37 +---------+ +-------+
40 +-----------+
42 +-----------+
45 +---------+ +---------+
46 | PCH-PIC | | PCH-MSI |
47 +---------+ +---------+
50 +---------+ +---------+ +---------+
51 | PCH-LPC | | Devices | | Devices |
52 +---------+ +---------+ +---------+
55 +---------+
57 +---------+
62 在这种模型里面，IPI（Inter-Processor Interrupt）和CPU本地时钟中断直接发送到CPUINTC，
63 CPU串口（UARTs）中断发送到LIOINTC，而其他所有设备的中断则分别发送到所连接的PCH-PIC/
64 PCH-LPC/PCH-MSI，然后被EIOINTC统一收集，再直接到达CPUINTC::
66 +-----+ +---------+ +-------+
67 | IPI | --> | CPUINTC | <-- | Timer |
68 +-----+ +---------+ +-------+
71 +---------+ +---------+ +-------+
72 | EIOINTC | | LIOINTC | <-- | UARTs |
73 +---------+ +---------+ +-------+
76 +---------+ +---------+
77 | PCH-PIC | | PCH-MSI |
78 +---------+ +---------+
81 +---------+ +---------+ +---------+
82 | PCH-LPC | | Devices | | Devices |
83 +---------+ +---------+ +---------+
86 +---------+
88 +---------+
93 在这种模型里面, IPI(Inter-Processor Interrupt) 和CPU本地时钟中断直接发送到CPUINTC,
94 CPU串口 (UARTs) 中断发送到PCH-PIC, 而其他所有设备的中断则分别发送到所连接的PCH_PIC/
95 PCH-MSI, 然后V-EIOINTC统一收集，再直接到达CPUINTC::
97 +-----+ +-------------------+ +-------+
98 | IPI |--> | CPUINTC(0-255vcpu)| <-- | Timer |
99 +-----+ +-------------------+ +-------+
102 +-----------+
103 | V-EIOINTC |
104 +-----------+
107 +---------+ +---------+
108 | PCH-PIC | | PCH-MSI |
109 +---------+ +---------+
112 +--------+ +---------+ +---------+
114 +--------+ +---------+ +---------+
116 V-EIOINTC 是EIOINTC的扩展, 仅工作在虚拟机模式下, 中断经EIOINTC最多可个路由到
117 ４个虚拟CPU. 但中断经V-EIOINTC最多可个路由到256个虚拟CPU.
123 EIOINTC中断控制器节点，中断只能路由到CPU0 - CPU3，中断管脚IP0-IP3。
125 V-EIOINTC新增了两个寄存器，支持中断路由到更多CPU个和中断管脚。
127 V-EIOINTC功能寄存器
128 -------------------
129 功能寄存器是只读寄存器，用于显示V-EIOINTC支持的特性，目前两个支持两个特性
134 管脚IP0 - IP15。
136 特性EXTIOI_HAS_CPU_ENCODE是V-EIOINTC新增特性，如果此比特为1，表示CPU路由
137 方式支持正常编码，而不是bitmap编码，所以中断可以路由到CPU0 - CPU255。
139 V-EIOINTC配置寄存器
140 -------------------
148 在这种模型里面，IPI（Inter-Processor Interrupt）和CPU本地时钟中断直接发送到CPUINTC，
149 CPU串口（UARTs）中断发送到LIOINTC，PCH-MSI中断发送到AVECINTC，而后通过AVECINTC直接
150 送达CPUINTC，而其他所有设备的中断则分别发送到所连接的PCH-PIC/PCH-LPC，然后由EIOINTC
153 +-----+ +-----------------------+ +-------+
154 | IPI | --> | CPUINTC | <-- | Timer |
155 +-----+ +-----------------------+ +-------+
158 +---------+ +----------+ +---------+ +-------+
159 | EIOINTC | | AVECINTC | | LIOINTC | <-- | UARTs |
160 +---------+ +----------+ +---------+ +-------+
163 +---------+ +---------+
164 | PCH-PIC | | PCH-MSI |
165 +---------+ +---------+
168 +---------+ +---------+ +---------+
169 | Devices | | PCH-LPC | | Devices |
170 +---------+ +---------+ +---------+
173 +---------+
175 +---------+
204 PCH-PIC::
210 PCH-MSI::
216 PCH-LPC::
227 …https://github.com/loongson/LoongArch-Documentation/releases/latest/download/Loongson-3A5000-userm…
229 …https://github.com/loongson/LoongArch-Documentation/releases/latest/download/Loongson-3A5000-userm…
233 …https://github.com/loongson/LoongArch-Documentation/releases/latest/download/Loongson-7A1000-userm…
235 …https://github.com/loongson/LoongArch-Documentation/releases/latest/download/Loongson-7A1000-userm…
238 - CPUINTC：即《龙芯架构参考手册卷一》第7.4节所描述的CSR.ECFG/CSR.ESTAT寄存器及其
240 - LIOINTC：即《龙芯3A5000处理器使用手册》第11.1节所描述的“传统I/O中断”；
241 - EIOINTC：即《龙芯3A5000处理器使用手册》第11.2节所描述的“扩展I/O中断”；
242 - HTVECINTC：即《龙芯3A5000处理器使用手册》第14.3节所描述的“HyperTransport中断”；
243 - PCH-PIC/PCH-MSI：即《龙芯7A1000桥片用户手册》第5章所描述的“中断控制器”；
244 - PCH-LPC：即《龙芯7A1000桥片用户手册》第24.3节所描述的“LPC中断”。